drivers/gpu/drm/nouveau/nv04_pm.c

   1 /*
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   3  *
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  21  *
  22  * Authors: Ben Skeggs
  23  */
  24
  25 #include "drmP.h"
  26 #include "nouveau_drv.h"
  27 #include "nouveau_hw.h"
  28
  29 struct nv04_pm_state {
  30         struct pll_lims pll;
  31         struct nouveau_pll_vals calc;
  32 };
  33
  34 int
  35 nv04_pm_clock_get(struct drm_device *dev, u32 id)
  36 {
  37         return nouveau_hw_get_clock(dev, id);
  38 }
  39
  40 void *
  41 nv04_pm_clock_pre(struct drm_device *dev, u32 id, int khz)
  42 {
  43         struct nv04_pm_state *state;
  44         int ret;
  45
  46         state = kzalloc(sizeof(*state), GFP_KERNEL);
  47         if (!state)
  48                 return ERR_PTR(-ENOMEM);
  49
  50         ret = get_pll_limits(dev, id, &state->pll);
  51         if (ret) {
  52                 kfree(state);
  53                 return (ret == -ENOENT) ? NULL : ERR_PTR(ret);
  54         }
  55
  56         ret = nouveau_calc_pll_mnp(dev, &state->pll, khz, &state->calc);
  57         if (!ret) {
  58                 kfree(state);
  59                 return ERR_PTR(-EINVAL);
  60         }
  61
  62         return state;
  63 }
  64
  65 void
  66 nv04_pm_clock_set(struct drm_device *dev, void *pre_state)
  67 {
  68         struct drm_nouveau_private *dev_priv = dev->dev_private;
  69         struct nv04_pm_state *state = pre_state;
  70         u32 reg = state->pll.reg;
  71
  72         /* thank the insane nouveau_hw_setpll() interface for this */
  73         if (dev_priv->card_type >= NV_40)
  74                 reg += 4;
  75
  76         nouveau_hw_setpll(dev, reg, &state->calc);
  77         kfree(state);
  78 }
  79