lib/Target/ARM/ARMInstrInfo.h

   1 //===- ARMInstrInfo.h - ARM Instruction Information -------------*- C++ -*-===//
   2 //
   3 //                     The LLVM Compiler Infrastructure
   4 //
   5 // This file is distributed under the University of Illinois Open Source
   6 // License. See LICENSE.TXT for details.
   7 //
   8 //===----------------------------------------------------------------------===//
   9 //
  10 // This file contains the ARM implementation of the TargetInstrInfo class.
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  12 //===----------------------------------------------------------------------===//
  13
  14 #ifndef ARMINSTRUCTIONINFO_H
  15 #define ARMINSTRUCTIONINFO_H
  16
  17 #include "llvm/Target/TargetInstrInfo.h"
  18 #include "ARMBaseInstrInfo.h"
  19 #include "ARMRegisterInfo.h"
  20 #include "ARMSubtarget.h"
  21 #include "ARM.h"
  22
  23 namespace llvm {
  24   class ARMSubtarget;
  25
  26 class ARMInstrInfo : public ARMBaseInstrInfo {
  27   ARMRegisterInfo RI;
  28 public:
  29   explicit ARMInstrInfo(const ARMSubtarget &STI);
  30
  31   // Return the non-pre/post incrementing version of 'Opc'. Return 0
  32   // if there is not such an opcode.
  33   unsigned getUnindexedOpcode(unsigned Opc) const;
  34
  35   // Return the opcode that implements 'Op', or 0 if no opcode
  36   unsigned getOpcode(ARMII::Op Op) const;
  37
  38   // Return true if the block does not fall through.
  39   bool BlockHasNoFallThrough(const MachineBasicBlock &MBB) const;
  40
  41   /// getRegisterInfo - TargetInstrInfo is a superset of MRegister info.  As
  42   /// such, whenever a client has an instance of instruction info, it should
  43   /// always be able to get register info as well (through this method).
  44   ///
  45   const ARMRegisterInfo &getRegisterInfo() const { return RI; }
  46
  47   void reMaterialize(MachineBasicBlock &MBB, MachineBasicBlock::iterator MI,
  48                      unsigned DestReg, unsigned SubIdx,
  49                      const MachineInstr *Orig) const;
  50 };
  51
  52 }
  53
  54 #endif