Eliminate asm parser's dependency on TargetMachine:
[oota-llvm.git] / lib / Target / MBlaze / MBlazeSubtarget.cpp
1 //===- MBlazeSubtarget.cpp - MBlaze Subtarget Information -------*- C++ -*-===//
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3 //                     The LLVM Compiler Infrastructure
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5 // This file is distributed under the University of Illinois Open Source
6 // License. See LICENSE.TXT for details.
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8 //===----------------------------------------------------------------------===//
9 //
10 // This file implements the MBlaze specific subclass of TargetSubtargetInfo.
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12 //===----------------------------------------------------------------------===//
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14 #include "MBlazeSubtarget.h"
15 #include "MBlaze.h"
16 #include "MBlazeRegisterInfo.h"
17 #include "llvm/Support/CommandLine.h"
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19 #define GET_SUBTARGETINFO_ENUM
20 #define GET_SUBTARGETINFO_MC_DESC
21 #define GET_SUBTARGETINFO_TARGET_DESC
22 #define GET_SUBTARGETINFO_CTOR
23 #include "MBlazeGenSubtargetInfo.inc"
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25 using namespace llvm;
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27 MBlazeSubtarget::MBlazeSubtarget(const std::string &TT,
28                                  const std::string &CPU,
29                                  const std::string &FS):
30   MBlazeGenSubtargetInfo(TT, CPU, FS),
31   HasBarrel(false), HasDiv(false), HasMul(false), HasPatCmp(false),
32   HasFPU(false), HasMul64(false), HasSqrt(false)
33 {
34   // Parse features string.
35   std::string CPUName = CPU;
36   if (CPUName.empty())
37     CPUName = "mblaze";
38   ParseSubtargetFeatures(CPUName, FS);
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40   // Only use instruction scheduling if the selected CPU has an instruction
41   // itinerary (the default CPU is the only one that doesn't).
42   HasItin = CPUName != "mblaze";
43   DEBUG(dbgs() << "CPU " << CPUName << "(" << HasItin << ")\n");
44
45   // Initialize scheduling itinerary for the specified CPU.
46   InstrItins = getInstrItineraryForCPU(CPUName);
47
48   // Compute the issue width of the MBlaze itineraries
49   computeIssueWidth();
50 }
51
52 void MBlazeSubtarget::computeIssueWidth() {
53   InstrItins.IssueWidth = 1;
54 }
55
56 bool MBlazeSubtarget::
57 enablePostRAScheduler(CodeGenOpt::Level OptLevel,
58                       TargetSubtargetInfo::AntiDepBreakMode& Mode,
59                       RegClassVector& CriticalPathRCs) const {
60   Mode = TargetSubtargetInfo::ANTIDEP_CRITICAL;
61   CriticalPathRCs.clear();
62   CriticalPathRCs.push_back(&MBlaze::GPRRegClass);
63   return HasItin && OptLevel >= CodeGenOpt::Default;
64 }