lib/Target/Mips/MCTargetDesc/MipsAsmBackend.cpp

   1 //===-- MipsASMBackend.cpp - Mips Asm Backend  ----------------------------===//
   2 //
   3 //                     The LLVM Compiler Infrastructure
   4 //
   5 // This file is distributed under the University of Illinois Open Source
   6 // License. See LICENSE.TXT for details.
   7 //
   8 //===----------------------------------------------------------------------===//
   9 //
  10 // This file implements the MipsAsmBackend and MipsELFObjectWriter classes.
  11 //
  12 //===----------------------------------------------------------------------===//
  13 //
  14
  15 #include "MipsFixupKinds.h"
  16 #include "MCTargetDesc/MipsMCTargetDesc.h"
  17 #include "llvm/MC/MCAsmBackend.h"
  18 #include "llvm/MC/MCAssembler.h"
  19 #include "llvm/MC/MCDirectives.h"
  20 #include "llvm/MC/MCELFObjectWriter.h"
  21 #include "llvm/MC/MCFixupKindInfo.h"
  22 #include "llvm/MC/MCObjectWriter.h"
  23 #include "llvm/MC/MCSubtargetInfo.h"
  24 #include "llvm/Support/ErrorHandling.h"
  25 #include "llvm/Support/raw_ostream.h"
  26
  27 using namespace llvm;
  28
  29 // Prepare value for the target space for it
  30 static unsigned adjustFixupValue(unsigned Kind, uint64_t Value) {
  31
  32   // Add/subtract and shift
  33   switch (Kind) {
  34   default:
  35     return 0;
  36   case FK_GPRel_4:
  37   case FK_Data_4:
  38   case Mips::fixup_Mips_LO16:
  39   case Mips::fixup_Mips_GPOFF_HI:
  40   case Mips::fixup_Mips_GPOFF_LO:
  41   case Mips::fixup_Mips_GOT_PAGE:
  42   case Mips::fixup_Mips_GOT_OFST:
  43     break;
  44   case Mips::fixup_Mips_PC16:
  45     // So far we are only using this type for branches.
  46     // For branches we start 1 instruction after the branch
  47     // so the displacement will be one instruction size less.
  48     Value -= 4;
  49     // The displacement is then divided by 4 to give us an 18 bit
  50     // address range.
  51     Value >>= 2;
  52     break;
  53   case Mips::fixup_Mips_26:
  54     // So far we are only using this type for jumps.
  55     // The displacement is then divided by 4 to give us an 28 bit
  56     // address range.
  57     Value >>= 2;
  58     break;
  59   case Mips::fixup_Mips_HI16:
  60   case Mips::fixup_Mips_GOT_Local:
  61     // Get the higher 16-bits. Also add 1 if bit 15 is 1.
  62     Value = ((Value + 0x8000) >> 16) & 0xffff;
  63     break;
  64   }
  65
  66   return Value;
  67 }
  68
  69 namespace {
  70 class MipsAsmBackend : public MCAsmBackend {
  71   Triple::OSType OSType;
  72   bool IsLittle; // Big or little endian
  73   bool Is64Bit;  // 32 or 64 bit words
  74
  75 public:
  76   MipsAsmBackend(const Target &T,  Triple::OSType _OSType,
  77                  bool _isLittle, bool _is64Bit)
  78     :MCAsmBackend(), OSType(_OSType), IsLittle(_isLittle), Is64Bit(_is64Bit) {}
  79
  80   MCObjectWriter *createObjectWriter(raw_ostream &OS) const {
  81     return createMipsELFObjectWriter(OS, OSType, IsLittle, Is64Bit);
  82   }
  83
  84   /// ApplyFixup - Apply the \arg Value for given \arg Fixup into the provided
  85   /// data fragment, at the offset specified by the fixup and following the
  86   /// fixup kind as appropriate.
  87   void applyFixup(const MCFixup &Fixup, char *Data, unsigned DataSize,
  88                   uint64_t Value) const {
  89     MCFixupKind Kind = Fixup.getKind();
  90     Value = adjustFixupValue((unsigned)Kind, Value);
  91
  92     if (!Value)
  93       return; // Doesn't change encoding.
  94
  95     // Where do we start in the object
  96     unsigned Offset = Fixup.getOffset();
  97     // Number of bytes we need to fixup
  98     unsigned NumBytes = (getFixupKindInfo(Kind).TargetSize + 7) / 8;
  99     // Used to point to big endian bytes
 100     unsigned FullSize;
 101
 102     switch ((unsigned)Kind) {
 103     case Mips::fixup_Mips_16:
 104       FullSize = 2;
 105       break;
 106     case Mips::fixup_Mips_64:
 107       FullSize = 8;
 108       break;
 109     default:
 110       FullSize = 4;
 111       break;
 112     }
 113
 114     // Grab current value, if any, from bits.
 115     uint64_t CurVal = 0;
 116
 117     for (unsigned i = 0; i != NumBytes; ++i) {
 118       unsigned Idx = IsLittle ? i : (FullSize - 1 - i);
 119       CurVal |= (uint64_t)((uint8_t)Data[Offset + Idx]) << (i*8);
 120     }
 121
 122     uint64_t Mask = ((uint64_t)(-1) >>
 123                      (64 - getFixupKindInfo(Kind).TargetSize));
 124     CurVal |= Value & Mask;
 125
 126     // Write out the fixed up bytes back to the code/data bits.
 127     for (unsigned i = 0; i != NumBytes; ++i) {
 128       unsigned Idx = IsLittle ? i : (FullSize - 1 - i);
 129       Data[Offset + Idx] = (uint8_t)((CurVal >> (i*8)) & 0xff);
 130     }
 131   }
 132
 133   unsigned getNumFixupKinds() const { return Mips::NumTargetFixupKinds; }
 134
 135   const MCFixupKindInfo &getFixupKindInfo(MCFixupKind Kind) const {
 136     const static MCFixupKindInfo Infos[Mips::NumTargetFixupKinds] = {
 137       // This table *must* be in same the order of fixup_* kinds in
 138       // MipsFixupKinds.h.
 139       //
 140       // name                    offset  bits  flags
 141       { "fixup_Mips_16",           0,     16,   0 },
 142       { "fixup_Mips_32",           0,     32,   0 },
 143       { "fixup_Mips_REL32",        0,     32,   0 },
 144       { "fixup_Mips_26",           0,     26,   0 },
 145       { "fixup_Mips_HI16",         0,     16,   0 },
 146       { "fixup_Mips_LO16",         0,     16,   0 },
 147       { "fixup_Mips_GPREL16",      0,     16,   0 },
 148       { "fixup_Mips_LITERAL",      0,     16,   0 },
 149       { "fixup_Mips_GOT_Global",   0,     16,   0 },
 150       { "fixup_Mips_GOT_Local",    0,     16,   0 },
 151       { "fixup_Mips_PC16",         0,     16,  MCFixupKindInfo::FKF_IsPCRel },
 152       { "fixup_Mips_CALL16",       0,     16,   0 },
 153       { "fixup_Mips_GPREL32",      0,     32,   0 },
 154       { "fixup_Mips_SHIFT5",       6,      5,   0 },
 155       { "fixup_Mips_SHIFT6",       6,      5,   0 },
 156       { "fixup_Mips_64",           0,     64,   0 },
 157       { "fixup_Mips_TLSGD",        0,     16,   0 },
 158       { "fixup_Mips_GOTTPREL",     0,     16,   0 },
 159       { "fixup_Mips_TPREL_HI",     0,     16,   0 },
 160       { "fixup_Mips_TPREL_LO",     0,     16,   0 },
 161       { "fixup_Mips_TLSLDM",       0,     16,   0 },
 162       { "fixup_Mips_DTPREL_HI",    0,     16,   0 },
 163       { "fixup_Mips_DTPREL_LO",    0,     16,   0 },
 164       { "fixup_Mips_Branch_PCRel", 0,     16,  MCFixupKindInfo::FKF_IsPCRel },
 165       { "fixup_Mips_GPOFF_HI",     0,     16,   0 },
 166       { "fixup_Mips_GPOFF_LO",     0,     16,   0 },
 167       { "fixup_Mips_GOT_PAGE",     0,     16,   0 },
 168       { "fixup_Mips_GOT_OFST",     0,     16,   0 }
 169     };
 170
 171     if (Kind < FirstTargetFixupKind)
 172       return MCAsmBackend::getFixupKindInfo(Kind);
 173
 174     assert(unsigned(Kind - FirstTargetFixupKind) < getNumFixupKinds() &&
 175            "Invalid kind!");
 176     return Infos[Kind - FirstTargetFixupKind];
 177   }
 178
 179   /// @name Target Relaxation Interfaces
 180   /// @{
 181
 182   /// MayNeedRelaxation - Check whether the given instruction may need
 183   /// relaxation.
 184   ///
 185   /// \param Inst - The instruction to test.
 186   bool mayNeedRelaxation(const MCInst &Inst) const {
 187     return false;
 188   }
 189
 190   /// fixupNeedsRelaxation - Target specific predicate for whether a given
 191   /// fixup requires the associated instruction to be relaxed.
 192   bool fixupNeedsRelaxation(const MCFixup &Fixup,
 193                             uint64_t Value,
 194                             const MCInstFragment *DF,
 195                             const MCAsmLayout &Layout) const {
 196     // FIXME.
 197     assert(0 && "RelaxInstruction() unimplemented");
 198     return false;
 199   }
 200
 201   /// RelaxInstruction - Relax the instruction in the given fragment
 202   /// to the next wider instruction.
 203   ///
 204   /// \param Inst - The instruction to relax, which may be the same
 205   /// as the output.
 206   /// \parm Res [output] - On return, the relaxed instruction.
 207   void relaxInstruction(const MCInst &Inst, MCInst &Res) const {
 208   }
 209
 210   /// @}
 211
 212   /// WriteNopData - Write an (optimal) nop sequence of Count bytes
 213   /// to the given output. If the target cannot generate such a sequence,
 214   /// it should return an error.
 215   ///
 216   /// \return - True on success.
 217   bool writeNopData(uint64_t Count, MCObjectWriter *OW) const {
 218     return true;
 219   }
 220 }; // class MipsAsmBackend
 221
 222 } // namespace
 223
 224 // MCAsmBackend
 225 MCAsmBackend *llvm::createMipsAsmBackendEL32(const Target &T, StringRef TT) {
 226   return new MipsAsmBackend(T, Triple(TT).getOS(),
 227                             /*IsLittle*/true, /*Is64Bit*/false);
 228 }
 229
 230 MCAsmBackend *llvm::createMipsAsmBackendEB32(const Target &T, StringRef TT) {
 231   return new MipsAsmBackend(T, Triple(TT).getOS(),
 232                             /*IsLittle*/false, /*Is64Bit*/false);
 233 }
 234
 235 MCAsmBackend *llvm::createMipsAsmBackendEL64(const Target &T, StringRef TT) {
 236   return new MipsAsmBackend(T, Triple(TT).getOS(),
 237                             /*IsLittle*/true, /*Is64Bit*/true);
 238 }
 239
 240 MCAsmBackend *llvm::createMipsAsmBackendEB64(const Target &T, StringRef TT) {
 241   return new MipsAsmBackend(T, Triple(TT).getOS(),
 242                             /*IsLittle*/false, /*Is64Bit*/true);
 243 }
 244