lib/Target/Mips/Mips32r6InstrInfo.td

   1 //=- Mips32r6InstrInfo.td - Mips32r6 Instruction Information -*- tablegen -*-=//
   2 //
   3 //                     The LLVM Compiler Infrastructure
   4 //
   5 // This file is distributed under the University of Illinois Open Source
   6 // License. See LICENSE.TXT for details.
   7 //
   8 //===----------------------------------------------------------------------===//
   9 //
  10 // This file describes Mips32r6 instructions.
  11 //
  12 //===----------------------------------------------------------------------===//
  13
  14 include "Mips32r6InstrFormats.td"
  15
  16 // Notes about removals/changes from MIPS32r6:
  17 // Unclear: ssnop
  18 // Reencoded: cache, pref
  19 // Reencoded: clo, clz
  20 // Reencoded: jr -> jalr
  21 // Reencoded: jr.hb -> jalr.hb
  22 // Reencoded: ldc2
  23 // Reencoded: ll, sc
  24 // Reencoded: lwc2
  25 // Reencoded: sdbbp
  26 // Reencoded: sdc2
  27 // Reencoded: swc2
  28 // Removed: /.ps$/, cvt.ps.s, cvt.ps.pw
  29 // Removed: addi
  30 // Removed: bc1any2, bc1any4
  31 // Removed: bc2[ft]
  32 // Removed: bc2f, bc2t
  33 // Removed: bgezal
  34 // Removed: bltzal
  35 // Removed: c.cond.fmt, bc1[ft]
  36 // Removed: div, divu
  37 // Removed: jalx
  38 // Removed: ldxc1
  39 // Removed: luxc1
  40 // Removed: lwl, lwr, lwle, lwre, swl, swr, swle, swre
  41 // Removed: lwxc1
  42 // Removed: madd.[ds], nmadd.[ds], nmsub.[ds], sub.[ds]
  43 // Removed: mfhi, mflo, mthi, mtlo, madd, maddu, msub, msubu, mul
  44 // Removed: movf, movt
  45 // Removed: movf.fmt, movt.fmt, movn.fmt, movz.fmt
  46 // Removed: movn, movz
  47 // Removed: mult, multu
  48 // Removed: prefx
  49 // Removed: sdxc1
  50 // Removed: suxc1
  51 // Removed: swxc1
  52 // Removed: teqi, tgei, tgeiu, tlti, tltiu, tnei
  53 // Rencoded: [ls][wd]c2
  54
  55 //===----------------------------------------------------------------------===//
  56 //
  57 // Instruction Encodings
  58 //
  59 //===----------------------------------------------------------------------===//
  60
  61 class AUI_ENC    : AUI_FM;
  62 class DIV_ENC    : SPECIAL_3R_FM<0b00010, 0b011010>;
  63 class DIVU_ENC   : SPECIAL_3R_FM<0b00010, 0b011011>;
  64 class MOD_ENC    : SPECIAL_3R_FM<0b00011, 0b011010>;
  65 class MODU_ENC   : SPECIAL_3R_FM<0b00011, 0b011011>;
  66 class MUH_ENC    : SPECIAL_3R_FM<0b00011, 0b011000>;
  67 class MUHU_ENC   : SPECIAL_3R_FM<0b00011, 0b011001>;
  68 class MUL_R6_ENC : SPECIAL_3R_FM<0b00010, 0b011000>;
  69 class MULU_ENC   : SPECIAL_3R_FM<0b00010, 0b011001>;
  70 class SEL_D_ENC  : COP1_3R_FM<0b010000, FIELD_FMT_D>;
  71 class SEL_S_ENC  : COP1_3R_FM<0b010000, FIELD_FMT_S>;
  72
  73 //===----------------------------------------------------------------------===//
  74 //
  75 // Instruction Descriptions
  76 //
  77 //===----------------------------------------------------------------------===//
  78
  79 class AUI_DESC_BASE<string instr_asm, RegisterOperand GPROpnd> {
  80   dag OutOperandList = (outs GPROpnd:$rs);
  81   dag InOperandList = (ins GPROpnd:$rt, simm16:$imm);
  82   string AsmString = !strconcat(instr_asm, "\t$rs, $rt, $imm");
  83   list<dag> Pattern = [];
  84 }
  85
  86 class AUI_DESC : AUI_DESC_BASE<"aui", GPR32Opnd>;
  87
  88 class DIVMOD_DESC_BASE<string instr_asm, RegisterOperand GPROpnd> {
  89   dag OutOperandList = (outs GPROpnd:$rd);
  90   dag InOperandList = (ins GPROpnd:$rs, GPROpnd:$rt);
  91   string AsmString = !strconcat(instr_asm, "\t$rd, $rs, $rt");
  92   list<dag> Pattern = [];
  93 }
  94
  95 class DIV_DESC  : DIVMOD_DESC_BASE<"div", GPR32Opnd>;
  96 class DIVU_DESC : DIVMOD_DESC_BASE<"divu", GPR32Opnd>;
  97 class MOD_DESC  : DIVMOD_DESC_BASE<"mod", GPR32Opnd>;
  98 class MODU_DESC : DIVMOD_DESC_BASE<"modu", GPR32Opnd>;
  99
 100 class MUL_R6_DESC_BASE<string instr_asm, RegisterOperand GPROpnd> {
 101   dag OutOperandList = (outs GPROpnd:$rd);
 102   dag InOperandList = (ins GPROpnd:$rs, GPROpnd:$rt);
 103   string AsmString = !strconcat(instr_asm, "\t$rd, $rs, $rt");
 104   list<dag> Pattern = [];
 105 }
 106
 107 class MUH_DESC    : MUL_R6_DESC_BASE<"muh", GPR32Opnd>;
 108 class MUHU_DESC   : MUL_R6_DESC_BASE<"muhu", GPR32Opnd>;
 109 class MUL_R6_DESC : MUL_R6_DESC_BASE<"mul", GPR32Opnd>;
 110 class MULU_DESC   : MUL_R6_DESC_BASE<"mulu", GPR32Opnd>;
 111
 112 class SEL_DESC_BASE<string instr_asm, RegisterOperand FGROpnd> {
 113   dag OutOperandList = (outs FGROpnd:$fd);
 114   dag InOperandList = (ins FGROpnd:$fd_in, FGROpnd:$fs, FGROpnd:$ft);
 115   string AsmString = !strconcat(instr_asm, "\t$fd, $fs, $ft");
 116   list<dag> Pattern = [];
 117   string Constraints = "$fd_in = $fd";
 118 }
 119
 120 class SEL_D_DESC : SEL_DESC_BASE<"sel.d", FGR64Opnd>;
 121 class SEL_S_DESC : SEL_DESC_BASE<"sel.s", FGR32Opnd>;
 122
 123 //===----------------------------------------------------------------------===//
 124 //
 125 // Instruction Definitions
 126 //
 127 //===----------------------------------------------------------------------===//
 128
 129 def ADDIUPC;
 130 def ALIGN; // Known as as BALIGN in DSP ASE
 131 def ALUIPC;
 132 def AUI : AUI_ENC, AUI_DESC, ISA_MIPS32R6;
 133 def AUIPC;
 134 def BALC;
 135 def BC1EQZ;
 136 def BC1NEZ;
 137 def BC2EQZ;
 138 def BC2NEZ;
 139 def BC;
 140 def BEQC;
 141 def BEQZALC;
 142 def BEQZC;
 143 def BGEC;  // Also aliased to blec with operands swapped
 144 def BGEUC; // Also aliased to bleuc with operands swapped
 145 def BGEZALC;
 146 def BGEZC;
 147 def BGTZALC;
 148 def BGTZC;
 149 def BITSWAP; // Known as BITREV in DSP ASE
 150 def BLEZALC;
 151 def BLEZC;
 152 def BLTC; // Also aliased to bgtc with operands swapped
 153 def BLTUC; // Also aliased to bgtuc with operands swapped
 154 def BLTZALC;
 155 def BLTZC;
 156 def BNEC;
 157 def BNEZALC;
 158 def BNEZC;
 159 def BNVC;
 160 def BOVC;
 161 def CLASS_D;
 162 def CLASS_S;
 163 def CMP_CC_D;
 164 def CMP_CC_S;
 165 def DIV : DIV_ENC, DIV_DESC, ISA_MIPS32R6;
 166 def DIVU : DIVU_ENC, DIVU_DESC, ISA_MIPS32R6;
 167 def JIALC;
 168 def JIC;
 169 // def LSA; // See MSA
 170 def LWPC;
 171 def LWUPC;
 172 def MADDF;
 173 def MAXA_D;
 174 def MAXA_S;
 175 def MAX_D;
 176 def MAX_S;
 177 def MINA_D;
 178 def MINA_S;
 179 def MIN_D;
 180 def MOD : MOD_ENC, MOD_DESC, ISA_MIPS32R6;
 181 def MODU : MODU_ENC, MODU_DESC, ISA_MIPS32R6;
 182 def MSUBF;
 183 def MUH    : MUH_ENC, MUH_DESC, ISA_MIPS32R6;
 184 def MUHU   : MUHU_ENC, MUHU_DESC, ISA_MIPS32R6;
 185 def MUL_R6 : MUL_R6_ENC, MUL_R6_DESC, ISA_MIPS32R6;
 186 def MULU   : MULU_ENC, MULU_DESC, ISA_MIPS32R6;
 187 def NAL; // BAL with rd=0
 188 def RINT_D;
 189 def RINT_S;
 190 def SELEQZ;
 191 def SELEQZ_D;
 192 def SELEQZ_S;
 193 def SELNEZ;
 194 def SELNEZ_D;
 195 def SELNEZ_S;
 196 def SEL_D : SEL_D_ENC, SEL_D_DESC, ISA_MIPS32R6;
 197 def SEL_S : SEL_S_ENC, SEL_S_DESC, ISA_MIPS32R6;