X86: FrameIndex addressing modes do have a base register.
[oota-llvm.git] / test / CodeGen / X86 / bss_pagealigned.ll
1 ; RUN: llc --code-model=kernel -march=x86-64 <%s -asm-verbose=0 | FileCheck %s
2 ; PR4933
3 target datalayout = "e-p:64:64:64-i1:8:8-i8:8:8-i16:16:16-i32:32:32-i64:64:64-f32:32:32-f64:64:64-v64:64:64-v128:128:128-a0:0:64-s0:64:64-f80:128:128"
4 target triple = "x86_64-unknown-linux-gnu"
5 %struct.kmem_cache_order_objects = type { i64 }
6 declare i8* @memset(i8*, i32, i64)
7 define void @unxlate_dev_mem_ptr(i64 %phis, i8* %addr) nounwind {
8   %pte.addr.i = alloca %struct.kmem_cache_order_objects*
9   %call8 = call i8* @memset(i8* bitcast ([512 x %struct.kmem_cache_order_objects]* @bm_pte to i8*), i32 0, i64 4096)
10 ; CHECK: movq    $bm_pte, %rdi
11 ; CHECK-NEXT: xorl    %esi, %esi
12 ; CHECK-NEXT: movl    $4096, %edx
13 ; CHECK-NEXT: callq   memset
14   ret void
15 }
16 @bm_pte = internal global [512 x %struct.kmem_cache_order_objects] zeroinitializer, section ".bss.page_aligned", align 4096
17 ; CHECK: .section        .bss.page_aligned,"aw",@nobits
18 ; CHECK-NEXT: .align  4096
19 ; CHECK-NEXT: bm_pte:
20 ; CHECK-NEXT: .zero   4096
21 ; CHECK-NEXT: .size   bm_pte, 4096