test/MC/Disassembler/ARM/unpredictable-RSC-arm.txt

   1 # RUN: llvm-mc --disassemble %s -triple=arm-apple-darwin9 2>&1 | FileCheck %s
   2
   3 # Opcode=261 Name=RSCrs Format=ARM_FORMAT_DPSOREGFRM(5)
   4 #  31 30 29 28 27 26 25 24 23 22 21 20 19 18 17 16 15 14 13 12 11 10  9  8  7  6  5  4  3  2  1  0
   5 # -------------------------------------------------------------------------------------------------
   6 # | 0: 0: 1: 1| 0: 0: 0: 0| 1: 1: 1: 0| 0: 1: 0: 0| 1: 1: 1: 1| 1: 0: 0: 0| 0: 1: 0: 1| 1: 1: 1: 1|
   7 # -------------------------------------------------------------------------------------------------
   8 # if d == 15 || n == 15 || m == 15 || s == 15 then UNPREDICTABLE;
   9
  10 # CHECK: warning: potentially undefined instruction encoding
  11 0x5f 0xf8 0xe4 0x30