drm/nouveau: mark most of our ioctls as deprecated, move to compat layer
authorBen Skeggs <bskeggs@redhat.com>
Tue, 8 May 2012 00:24:27 +0000 (10:24 +1000)
committerBen Skeggs <bskeggs@redhat.com>
Thu, 26 Jul 2012 00:28:15 +0000 (10:28 +1000)
These will be replaced in the near future, the code isn't yet stable enough
for this merge window however.

Signed-off-by: Ben Skeggs <bskeggs@redhat.com>
drivers/gpu/drm/nouveau/Makefile
drivers/gpu/drm/nouveau/nouveau_abi16.c [new file with mode: 0644]
drivers/gpu/drm/nouveau/nouveau_abi16.h [new file with mode: 0644]
drivers/gpu/drm/nouveau/nouveau_channel.c
drivers/gpu/drm/nouveau/nouveau_drv.c
drivers/gpu/drm/nouveau/nouveau_drv.h
drivers/gpu/drm/nouveau/nouveau_gpuobj.c
drivers/gpu/drm/nouveau/nouveau_notifier.c
drivers/gpu/drm/nouveau/nouveau_state.c
include/drm/nouveau_drm.h

index efa1aef35f3a6815317d48c403e64c7bc429d452..1cece6a78f397d02b092590656c2b38bde29a8f0 100644 (file)
@@ -12,6 +12,7 @@ nouveau-y := nouveau_drv.o nouveau_state.o nouveau_channel.o nouveau_mem.o \
              nouveau_hdmi.o nouveau_dp.o nouveau_ramht.o \
             nouveau_pm.o nouveau_volt.o nouveau_perf.o nouveau_temp.o \
             nouveau_mm.o nouveau_vm.o nouveau_mxm.o nouveau_gpio.o \
+            nouveau_abi16.o \
              nv04_timer.o \
              nv04_mc.o nv40_mc.o nv50_mc.o \
              nv04_fb.o nv10_fb.o nv20_fb.o nv30_fb.o nv40_fb.o \
diff --git a/drivers/gpu/drm/nouveau/nouveau_abi16.c b/drivers/gpu/drm/nouveau/nouveau_abi16.c
new file mode 100644 (file)
index 0000000..ff23d88
--- /dev/null
@@ -0,0 +1,245 @@
+/*
+ * Copyright 2012 Red Hat Inc.
+ *
+ * Permission is hereby granted, free of charge, to any person obtaining a
+ * copy of this software and associated documentation files (the "Software"),
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+ *
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+ * ARISING FROM, OUT OF OR IN CONNECTION WITH THE SOFTWARE OR THE USE OR
+ * OTHER DEALINGS IN THE SOFTWARE.
+ *
+ */
+
+#include "drmP.h"
+
+#include "nouveau_drv.h"
+#include "nouveau_dma.h"
+#include "nouveau_abi16.h"
+#include "nouveau_ramht.h"
+#include "nouveau_software.h"
+
+int
+nouveau_abi16_ioctl_getparam(ABI16_IOCTL_ARGS)
+{
+       struct drm_nouveau_private *dev_priv = dev->dev_private;
+       struct drm_nouveau_getparam *getparam = data;
+
+       switch (getparam->param) {
+       case NOUVEAU_GETPARAM_CHIPSET_ID:
+               getparam->value = dev_priv->chipset;
+               break;
+       case NOUVEAU_GETPARAM_PCI_VENDOR:
+               getparam->value = dev->pci_vendor;
+               break;
+       case NOUVEAU_GETPARAM_PCI_DEVICE:
+               getparam->value = dev->pci_device;
+               break;
+       case NOUVEAU_GETPARAM_BUS_TYPE:
+               if (drm_pci_device_is_agp(dev))
+                       getparam->value = 0;
+               else
+               if (!pci_is_pcie(dev->pdev))
+                       getparam->value = 1;
+               else
+                       getparam->value = 2;
+               break;
+       case NOUVEAU_GETPARAM_FB_SIZE:
+               getparam->value = dev_priv->fb_available_size;
+               break;
+       case NOUVEAU_GETPARAM_AGP_SIZE:
+               getparam->value = dev_priv->gart_info.aper_size;
+               break;
+       case NOUVEAU_GETPARAM_VM_VRAM_BASE:
+               getparam->value = 0; /* deprecated */
+               break;
+       case NOUVEAU_GETPARAM_PTIMER_TIME:
+               getparam->value = dev_priv->engine.timer.read(dev);
+               break;
+       case NOUVEAU_GETPARAM_HAS_BO_USAGE:
+               getparam->value = 1;
+               break;
+       case NOUVEAU_GETPARAM_HAS_PAGEFLIP:
+               getparam->value = 1;
+               break;
+       case NOUVEAU_GETPARAM_GRAPH_UNITS:
+               /* NV40 and NV50 versions are quite different, but register
+                * address is the same. User is supposed to know the card
+                * family anyway... */
+               if (dev_priv->chipset >= 0x40) {
+                       getparam->value = nv_rd32(dev, NV40_PMC_GRAPH_UNITS);
+                       break;
+               }
+               /* FALLTHRU */
+       default:
+               NV_DEBUG(dev, "unknown parameter %lld\n", getparam->param);
+               return -EINVAL;
+       }
+
+       return 0;
+}
+
+int
+nouveau_abi16_ioctl_setparam(ABI16_IOCTL_ARGS)
+{
+       return -EINVAL;
+}
+
+int
+nouveau_abi16_ioctl_channel_alloc(ABI16_IOCTL_ARGS)
+{
+       struct drm_nouveau_private *dev_priv = dev->dev_private;
+       struct drm_nouveau_channel_alloc *init = data;
+       struct nouveau_channel *chan;
+       int ret;
+
+       if (!dev_priv->eng[NVOBJ_ENGINE_GR])
+               return -ENODEV;
+
+       if (init->fb_ctxdma_handle == ~0 || init->tt_ctxdma_handle == ~0)
+               return -EINVAL;
+
+       ret = nouveau_channel_alloc(dev, &chan, file_priv,
+                                   init->fb_ctxdma_handle,
+                                   init->tt_ctxdma_handle);
+       if (ret)
+               return ret;
+       init->channel  = chan->id;
+
+       if (nouveau_vram_pushbuf == 0) {
+               if (chan->dma.ib_max)
+                       init->pushbuf_domains = NOUVEAU_GEM_DOMAIN_VRAM |
+                                               NOUVEAU_GEM_DOMAIN_GART;
+               else if (chan->pushbuf_bo->bo.mem.mem_type == TTM_PL_VRAM)
+                       init->pushbuf_domains = NOUVEAU_GEM_DOMAIN_VRAM;
+               else
+                       init->pushbuf_domains = NOUVEAU_GEM_DOMAIN_GART;
+       } else {
+               init->pushbuf_domains = NOUVEAU_GEM_DOMAIN_VRAM;
+       }
+
+       if (dev_priv->card_type < NV_C0) {
+               init->subchan[0].handle = 0x00000000;
+               init->subchan[0].grclass = 0x0000;
+               init->subchan[1].handle = NvSw;
+               init->subchan[1].grclass = NV_SW;
+               init->nr_subchan = 2;
+       }
+
+       /* Named memory object area */
+       ret = drm_gem_handle_create(file_priv, chan->notifier_bo->gem,
+                                   &init->notifier_handle);
+
+       if (ret == 0)
+               atomic_inc(&chan->users); /* userspace reference */
+       nouveau_channel_put(&chan);
+       return ret;
+}
+
+int
+nouveau_abi16_ioctl_channel_free(ABI16_IOCTL_ARGS)
+{
+       struct drm_nouveau_channel_free *req = data;
+       struct nouveau_channel *chan;
+
+       chan = nouveau_channel_get(file_priv, req->channel);
+       if (IS_ERR(chan))
+               return PTR_ERR(chan);
+
+       list_del(&chan->list);
+       atomic_dec(&chan->users);
+       nouveau_channel_put(&chan);
+       return 0;
+}
+
+int
+nouveau_abi16_ioctl_grobj_alloc(ABI16_IOCTL_ARGS)
+{
+       struct drm_nouveau_grobj_alloc *init = data;
+       struct nouveau_channel *chan;
+       int ret;
+
+       if (init->handle == ~0)
+               return -EINVAL;
+
+       /* compatibility with userspace that assumes 506e for all chipsets */
+       if (init->class == 0x506e) {
+               init->class = nouveau_software_class(dev);
+               if (init->class == 0x906e)
+                       return 0;
+       } else
+       if (init->class == 0x906e) {
+               NV_ERROR(dev, "906e not supported yet\n");
+               return -EINVAL;
+       }
+
+       chan = nouveau_channel_get(file_priv, init->channel);
+       if (IS_ERR(chan))
+               return PTR_ERR(chan);
+
+       if (nouveau_ramht_find(chan, init->handle)) {
+               ret = -EEXIST;
+               goto out;
+       }
+
+       ret = nouveau_gpuobj_gr_new(chan, init->handle, init->class);
+       if (ret) {
+               NV_ERROR(dev, "Error creating object: %d (%d/0x%08x)\n",
+                        ret, init->channel, init->handle);
+       }
+
+out:
+       nouveau_channel_put(&chan);
+       return ret;
+}
+
+int
+nouveau_abi16_ioctl_notifierobj_alloc(ABI16_IOCTL_ARGS)
+{
+       struct drm_nouveau_private *dev_priv = dev->dev_private;
+       struct drm_nouveau_notifierobj_alloc *na = data;
+       struct nouveau_channel *chan;
+       int ret;
+
+       /* completely unnecessary for these chipsets... */
+       if (unlikely(dev_priv->card_type >= NV_C0))
+               return -EINVAL;
+
+       chan = nouveau_channel_get(file_priv, na->channel);
+       if (IS_ERR(chan))
+               return PTR_ERR(chan);
+
+       ret = nouveau_notifier_alloc(chan, na->handle, na->size, 0, 0x1000,
+                                    &na->offset);
+       nouveau_channel_put(&chan);
+       return ret;
+}
+
+int
+nouveau_abi16_ioctl_gpuobj_free(ABI16_IOCTL_ARGS)
+{
+       struct drm_nouveau_gpuobj_free *objfree = data;
+       struct nouveau_channel *chan;
+       int ret;
+
+       chan = nouveau_channel_get(file_priv, objfree->channel);
+       if (IS_ERR(chan))
+               return PTR_ERR(chan);
+
+       /* Synchronize with the user channel */
+       nouveau_channel_idle(chan);
+
+       ret = nouveau_ramht_remove(chan, objfree->handle);
+       nouveau_channel_put(&chan);
+       return ret;
+}
diff --git a/drivers/gpu/drm/nouveau/nouveau_abi16.h b/drivers/gpu/drm/nouveau/nouveau_abi16.h
new file mode 100644 (file)
index 0000000..e6328b0
--- /dev/null
@@ -0,0 +1,83 @@
+#ifndef __NOUVEAU_ABI16_H__
+#define __NOUVEAU_ABI16_H__
+
+#define ABI16_IOCTL_ARGS                                                       \
+       struct drm_device *dev, void *data, struct drm_file *file_priv
+int nouveau_abi16_ioctl_getparam(ABI16_IOCTL_ARGS);
+int nouveau_abi16_ioctl_setparam(ABI16_IOCTL_ARGS);
+int nouveau_abi16_ioctl_channel_alloc(ABI16_IOCTL_ARGS);
+int nouveau_abi16_ioctl_channel_free(ABI16_IOCTL_ARGS);
+int nouveau_abi16_ioctl_grobj_alloc(ABI16_IOCTL_ARGS);
+int nouveau_abi16_ioctl_notifierobj_alloc(ABI16_IOCTL_ARGS);
+int nouveau_abi16_ioctl_gpuobj_free(ABI16_IOCTL_ARGS);
+
+struct drm_nouveau_channel_alloc {
+       uint32_t     fb_ctxdma_handle;
+       uint32_t     tt_ctxdma_handle;
+
+       int          channel;
+       uint32_t     pushbuf_domains;
+
+       /* Notifier memory */
+       uint32_t     notifier_handle;
+
+       /* DRM-enforced subchannel assignments */
+       struct {
+               uint32_t handle;
+               uint32_t grclass;
+       } subchan[8];
+       uint32_t nr_subchan;
+};
+
+struct drm_nouveau_channel_free {
+       int channel;
+};
+
+struct drm_nouveau_grobj_alloc {
+       int      channel;
+       uint32_t handle;
+       int      class;
+};
+
+struct drm_nouveau_notifierobj_alloc {
+       uint32_t channel;
+       uint32_t handle;
+       uint32_t size;
+       uint32_t offset;
+};
+
+struct drm_nouveau_gpuobj_free {
+       int      channel;
+       uint32_t handle;
+};
+
+#define NOUVEAU_GETPARAM_PCI_VENDOR      3
+#define NOUVEAU_GETPARAM_PCI_DEVICE      4
+#define NOUVEAU_GETPARAM_BUS_TYPE        5
+#define NOUVEAU_GETPARAM_FB_SIZE         8
+#define NOUVEAU_GETPARAM_AGP_SIZE        9
+#define NOUVEAU_GETPARAM_CHIPSET_ID      11
+#define NOUVEAU_GETPARAM_VM_VRAM_BASE    12
+#define NOUVEAU_GETPARAM_GRAPH_UNITS     13
+#define NOUVEAU_GETPARAM_PTIMER_TIME     14
+#define NOUVEAU_GETPARAM_HAS_BO_USAGE    15
+#define NOUVEAU_GETPARAM_HAS_PAGEFLIP    16
+struct drm_nouveau_getparam {
+       uint64_t param;
+       uint64_t value;
+};
+
+struct drm_nouveau_setparam {
+       uint64_t param;
+       uint64_t value;
+};
+
+#define DRM_IOCTL_NOUVEAU_GETPARAM           DRM_IOWR(DRM_COMMAND_BASE + DRM_NOUVEAU_GETPARAM, struct drm_nouveau_getparam)
+#define DRM_IOCTL_NOUVEAU_SETPARAM           DRM_IOWR(DRM_COMMAND_BASE + DRM_NOUVEAU_SETPARAM, struct drm_nouveau_setparam)
+#define DRM_IOCTL_NOUVEAU_CHANNEL_ALLOC      DRM_IOWR(DRM_COMMAND_BASE + DRM_NOUVEAU_CHANNEL_ALLOC, struct drm_nouveau_channel_alloc)
+#define DRM_IOCTL_NOUVEAU_CHANNEL_FREE       DRM_IOW (DRM_COMMAND_BASE + DRM_NOUVEAU_CHANNEL_FREE, struct drm_nouveau_channel_free)
+#define DRM_IOCTL_NOUVEAU_GROBJ_ALLOC        DRM_IOW (DRM_COMMAND_BASE + DRM_NOUVEAU_GROBJ_ALLOC, struct drm_nouveau_grobj_alloc)
+#define DRM_IOCTL_NOUVEAU_NOTIFIEROBJ_ALLOC  DRM_IOWR(DRM_COMMAND_BASE + DRM_NOUVEAU_NOTIFIEROBJ_ALLOC, struct drm_nouveau_notifierobj_alloc)
+#define DRM_IOCTL_NOUVEAU_GPUOBJ_FREE        DRM_IOW (DRM_COMMAND_BASE + DRM_NOUVEAU_GPUOBJ_FREE, struct drm_nouveau_gpuobj_free)
+
+#endif
index 629d8a2df5bd2d6214bdd663ad7bee450afaeb0e..debd90225a88d9d633c6d4a5cd59a526877c1b14 100644 (file)
@@ -395,98 +395,3 @@ nouveau_channel_cleanup(struct drm_device *dev, struct drm_file *file_priv)
                nouveau_channel_put(&chan);
        }
 }
-
-
-/***********************************
- * ioctls wrapping the functions
- ***********************************/
-
-static int
-nouveau_ioctl_fifo_alloc(struct drm_device *dev, void *data,
-                        struct drm_file *file_priv)
-{
-       struct drm_nouveau_private *dev_priv = dev->dev_private;
-       struct drm_nouveau_channel_alloc *init = data;
-       struct nouveau_channel *chan;
-       int ret;
-
-       if (!dev_priv->eng[NVOBJ_ENGINE_GR])
-               return -ENODEV;
-
-       if (init->fb_ctxdma_handle == ~0 || init->tt_ctxdma_handle == ~0)
-               return -EINVAL;
-
-       ret = nouveau_channel_alloc(dev, &chan, file_priv,
-                                   init->fb_ctxdma_handle,
-                                   init->tt_ctxdma_handle);
-       if (ret)
-               return ret;
-       init->channel  = chan->id;
-
-       if (nouveau_vram_pushbuf == 0) {
-               if (chan->dma.ib_max)
-                       init->pushbuf_domains = NOUVEAU_GEM_DOMAIN_VRAM |
-                                               NOUVEAU_GEM_DOMAIN_GART;
-               else if (chan->pushbuf_bo->bo.mem.mem_type == TTM_PL_VRAM)
-                       init->pushbuf_domains = NOUVEAU_GEM_DOMAIN_VRAM;
-               else
-                       init->pushbuf_domains = NOUVEAU_GEM_DOMAIN_GART;
-       } else {
-               init->pushbuf_domains = NOUVEAU_GEM_DOMAIN_VRAM;
-       }
-
-       if (dev_priv->card_type < NV_C0) {
-               init->subchan[0].handle = 0x00000000;
-               init->subchan[0].grclass = 0x0000;
-               init->subchan[1].handle = NvSw;
-               init->subchan[1].grclass = NV_SW;
-               init->nr_subchan = 2;
-       }
-
-       /* Named memory object area */
-       ret = drm_gem_handle_create(file_priv, chan->notifier_bo->gem,
-                                   &init->notifier_handle);
-
-       if (ret == 0)
-               atomic_inc(&chan->users); /* userspace reference */
-       nouveau_channel_put(&chan);
-       return ret;
-}
-
-static int
-nouveau_ioctl_fifo_free(struct drm_device *dev, void *data,
-                       struct drm_file *file_priv)
-{
-       struct drm_nouveau_channel_free *req = data;
-       struct nouveau_channel *chan;
-
-       chan = nouveau_channel_get(file_priv, req->channel);
-       if (IS_ERR(chan))
-               return PTR_ERR(chan);
-
-       list_del(&chan->list);
-       atomic_dec(&chan->users);
-       nouveau_channel_put(&chan);
-       return 0;
-}
-
-/***********************************
- * finally, the ioctl table
- ***********************************/
-
-struct drm_ioctl_desc nouveau_ioctls[] = {
-       DRM_IOCTL_DEF_DRV(NOUVEAU_GETPARAM, nouveau_ioctl_getparam, DRM_UNLOCKED|DRM_AUTH),
-       DRM_IOCTL_DEF_DRV(NOUVEAU_SETPARAM, nouveau_ioctl_setparam, DRM_UNLOCKED|DRM_AUTH|DRM_MASTER|DRM_ROOT_ONLY),
-       DRM_IOCTL_DEF_DRV(NOUVEAU_CHANNEL_ALLOC, nouveau_ioctl_fifo_alloc, DRM_UNLOCKED|DRM_AUTH),
-       DRM_IOCTL_DEF_DRV(NOUVEAU_CHANNEL_FREE, nouveau_ioctl_fifo_free, DRM_UNLOCKED|DRM_AUTH),
-       DRM_IOCTL_DEF_DRV(NOUVEAU_GROBJ_ALLOC, nouveau_ioctl_grobj_alloc, DRM_UNLOCKED|DRM_AUTH),
-       DRM_IOCTL_DEF_DRV(NOUVEAU_NOTIFIEROBJ_ALLOC, nouveau_ioctl_notifier_alloc, DRM_UNLOCKED|DRM_AUTH),
-       DRM_IOCTL_DEF_DRV(NOUVEAU_GPUOBJ_FREE, nouveau_ioctl_gpuobj_free, DRM_UNLOCKED|DRM_AUTH),
-       DRM_IOCTL_DEF_DRV(NOUVEAU_GEM_NEW, nouveau_gem_ioctl_new, DRM_UNLOCKED|DRM_AUTH),
-       DRM_IOCTL_DEF_DRV(NOUVEAU_GEM_PUSHBUF, nouveau_gem_ioctl_pushbuf, DRM_UNLOCKED|DRM_AUTH),
-       DRM_IOCTL_DEF_DRV(NOUVEAU_GEM_CPU_PREP, nouveau_gem_ioctl_cpu_prep, DRM_UNLOCKED|DRM_AUTH),
-       DRM_IOCTL_DEF_DRV(NOUVEAU_GEM_CPU_FINI, nouveau_gem_ioctl_cpu_fini, DRM_UNLOCKED|DRM_AUTH),
-       DRM_IOCTL_DEF_DRV(NOUVEAU_GEM_INFO, nouveau_gem_ioctl_info, DRM_UNLOCKED|DRM_AUTH),
-};
-
-int nouveau_max_ioctl = DRM_ARRAY_SIZE(nouveau_ioctls);
index cad254c8e387ed4c556a260cfbc28a98efef5146..727447d296f1131bebcade79f12cbf212c53ef0c 100644 (file)
@@ -29,6 +29,7 @@
 #include "drm.h"
 #include "drm_crtc_helper.h"
 #include "nouveau_drv.h"
+#include "nouveau_abi16.h"
 #include "nouveau_hw.h"
 #include "nouveau_fb.h"
 #include "nouveau_fbcon.h"
@@ -384,6 +385,21 @@ nouveau_pci_resume(struct pci_dev *pdev)
        return 0;
 }
 
+static struct drm_ioctl_desc nouveau_ioctls[] = {
+       DRM_IOCTL_DEF_DRV(NOUVEAU_GETPARAM, nouveau_abi16_ioctl_getparam, DRM_UNLOCKED|DRM_AUTH),
+       DRM_IOCTL_DEF_DRV(NOUVEAU_SETPARAM, nouveau_abi16_ioctl_setparam, DRM_UNLOCKED|DRM_AUTH|DRM_MASTER|DRM_ROOT_ONLY),
+       DRM_IOCTL_DEF_DRV(NOUVEAU_CHANNEL_ALLOC, nouveau_abi16_ioctl_channel_alloc, DRM_UNLOCKED|DRM_AUTH),
+       DRM_IOCTL_DEF_DRV(NOUVEAU_CHANNEL_FREE, nouveau_abi16_ioctl_channel_free, DRM_UNLOCKED|DRM_AUTH),
+       DRM_IOCTL_DEF_DRV(NOUVEAU_GROBJ_ALLOC, nouveau_abi16_ioctl_grobj_alloc, DRM_UNLOCKED|DRM_AUTH),
+       DRM_IOCTL_DEF_DRV(NOUVEAU_NOTIFIEROBJ_ALLOC, nouveau_abi16_ioctl_notifierobj_alloc, DRM_UNLOCKED|DRM_AUTH),
+       DRM_IOCTL_DEF_DRV(NOUVEAU_GPUOBJ_FREE, nouveau_abi16_ioctl_gpuobj_free, DRM_UNLOCKED|DRM_AUTH),
+       DRM_IOCTL_DEF_DRV(NOUVEAU_GEM_NEW, nouveau_gem_ioctl_new, DRM_UNLOCKED|DRM_AUTH),
+       DRM_IOCTL_DEF_DRV(NOUVEAU_GEM_PUSHBUF, nouveau_gem_ioctl_pushbuf, DRM_UNLOCKED|DRM_AUTH),
+       DRM_IOCTL_DEF_DRV(NOUVEAU_GEM_CPU_PREP, nouveau_gem_ioctl_cpu_prep, DRM_UNLOCKED|DRM_AUTH),
+       DRM_IOCTL_DEF_DRV(NOUVEAU_GEM_CPU_FINI, nouveau_gem_ioctl_cpu_fini, DRM_UNLOCKED|DRM_AUTH),
+       DRM_IOCTL_DEF_DRV(NOUVEAU_GEM_INFO, nouveau_gem_ioctl_info, DRM_UNLOCKED|DRM_AUTH),
+};
+
 static const struct file_operations nouveau_driver_fops = {
        .owner = THIS_MODULE,
        .open = drm_open,
@@ -463,7 +479,7 @@ static struct pci_driver nouveau_pci_driver = {
 
 static int __init nouveau_init(void)
 {
-       driver.num_ioctls = nouveau_max_ioctl;
+       driver.num_ioctls = ARRAY_SIZE(nouveau_ioctls);
 
        if (nouveau_modeset == -1) {
 #ifdef CONFIG_VGA_CONSOLE
index b0f8dd0373cd16f38ec16e9697808e5d4701eda2..a5dc984951252207cd9b3824625c6616dda55be1 100644 (file)
@@ -872,10 +872,6 @@ extern int  nouveau_load(struct drm_device *, unsigned long flags);
 extern int  nouveau_firstopen(struct drm_device *);
 extern void nouveau_lastclose(struct drm_device *);
 extern int  nouveau_unload(struct drm_device *);
-extern int  nouveau_ioctl_getparam(struct drm_device *, void *data,
-                                  struct drm_file *);
-extern int  nouveau_ioctl_setparam(struct drm_device *, void *data,
-                                  struct drm_file *);
 extern bool nouveau_wait_eq(struct drm_device *, uint64_t timeout,
                            uint32_t reg, uint32_t mask, uint32_t val);
 extern bool nouveau_wait_ne(struct drm_device *, uint64_t timeout,
@@ -915,14 +911,8 @@ extern int  nouveau_notifier_alloc(struct nouveau_channel *, uint32_t handle,
                                   int cout, uint32_t start, uint32_t end,
                                   uint32_t *offset);
 extern int  nouveau_notifier_offset(struct nouveau_gpuobj *, uint32_t *);
-extern int  nouveau_ioctl_notifier_alloc(struct drm_device *, void *data,
-                                        struct drm_file *);
-extern int  nouveau_ioctl_notifier_free(struct drm_device *, void *data,
-                                       struct drm_file *);
 
 /* nouveau_channel.c */
-extern struct drm_ioctl_desc nouveau_ioctls[];
-extern int nouveau_max_ioctl;
 extern void nouveau_channel_cleanup(struct drm_device *, struct drm_file *);
 extern int  nouveau_channel_alloc(struct drm_device *dev,
                                  struct nouveau_channel **chan,
@@ -993,10 +983,6 @@ extern int nv50_gpuobj_dma_new(struct nouveau_channel *, int class, u64 base,
 extern void nv50_gpuobj_dma_init(struct nouveau_gpuobj *, u32 offset,
                                 int class, u64 base, u64 size, int target,
                                 int access, u32 type, u32 comp);
-extern int nouveau_ioctl_grobj_alloc(struct drm_device *, void *data,
-                                    struct drm_file *);
-extern int nouveau_ioctl_gpuobj_free(struct drm_device *, void *data,
-                                    struct drm_file *);
 
 /* nouveau_irq.c */
 extern int         nouveau_irq_init(struct drm_device *);
index b190cc01c820308c1991d42430e8ebd594acfd59..bd79fedb70541245ac97fc8587b6b66e006f6a83 100644 (file)
@@ -758,66 +758,6 @@ nouveau_gpuobj_resume(struct drm_device *dev)
        dev_priv->engine.instmem.flush(dev);
 }
 
-int nouveau_ioctl_grobj_alloc(struct drm_device *dev, void *data,
-                             struct drm_file *file_priv)
-{
-       struct drm_nouveau_grobj_alloc *init = data;
-       struct nouveau_channel *chan;
-       int ret;
-
-       if (init->handle == ~0)
-               return -EINVAL;
-
-       /* compatibility with userspace that assumes 506e for all chipsets */
-       if (init->class == 0x506e) {
-               init->class = nouveau_software_class(dev);
-               if (init->class == 0x906e)
-                       return 0;
-       } else
-       if (init->class == 0x906e) {
-               NV_ERROR(dev, "906e not supported yet\n");
-               return -EINVAL;
-       }
-
-       chan = nouveau_channel_get(file_priv, init->channel);
-       if (IS_ERR(chan))
-               return PTR_ERR(chan);
-
-       if (nouveau_ramht_find(chan, init->handle)) {
-               ret = -EEXIST;
-               goto out;
-       }
-
-       ret = nouveau_gpuobj_gr_new(chan, init->handle, init->class);
-       if (ret) {
-               NV_ERROR(dev, "Error creating object: %d (%d/0x%08x)\n",
-                        ret, init->channel, init->handle);
-       }
-
-out:
-       nouveau_channel_put(&chan);
-       return ret;
-}
-
-int nouveau_ioctl_gpuobj_free(struct drm_device *dev, void *data,
-                             struct drm_file *file_priv)
-{
-       struct drm_nouveau_gpuobj_free *objfree = data;
-       struct nouveau_channel *chan;
-       int ret;
-
-       chan = nouveau_channel_get(file_priv, objfree->channel);
-       if (IS_ERR(chan))
-               return PTR_ERR(chan);
-
-       /* Synchronize with the user channel */
-       nouveau_channel_idle(chan);
-
-       ret = nouveau_ramht_remove(chan, objfree->handle);
-       nouveau_channel_put(&chan);
-       return ret;
-}
-
 u32
 nv_ro32(struct nouveau_gpuobj *gpuobj, u32 offset)
 {
index 2ef883c4bbc182cc85d1db2326a5c0d7cc3a6b64..aa549155dcc18dbeb4b2ccd6bb2d33ff0a33c184 100644 (file)
@@ -179,26 +179,3 @@ nouveau_notifier_offset(struct nouveau_gpuobj *nobj, uint32_t *poffset)
 
        return 0;
 }
-
-int
-nouveau_ioctl_notifier_alloc(struct drm_device *dev, void *data,
-                            struct drm_file *file_priv)
-{
-       struct drm_nouveau_private *dev_priv = dev->dev_private;
-       struct drm_nouveau_notifierobj_alloc *na = data;
-       struct nouveau_channel *chan;
-       int ret;
-
-       /* completely unnecessary for these chipsets... */
-       if (unlikely(dev_priv->card_type >= NV_C0))
-               return -EINVAL;
-
-       chan = nouveau_channel_get(file_priv, na->channel);
-       if (IS_ERR(chan))
-               return PTR_ERR(chan);
-
-       ret = nouveau_notifier_alloc(chan, na->handle, na->size, 0, 0x1000,
-                                    &na->offset);
-       nouveau_channel_put(&chan);
-       return ret;
-}
index 19706f0532eac60deb973b0b994ad0065a04f980..1cdfd6e757ce7455c03ea35eaef42dbe6253ab7b 100644 (file)
@@ -1234,80 +1234,6 @@ int nouveau_unload(struct drm_device *dev)
        return 0;
 }
 
-int nouveau_ioctl_getparam(struct drm_device *dev, void *data,
-                                               struct drm_file *file_priv)
-{
-       struct drm_nouveau_private *dev_priv = dev->dev_private;
-       struct drm_nouveau_getparam *getparam = data;
-
-       switch (getparam->param) {
-       case NOUVEAU_GETPARAM_CHIPSET_ID:
-               getparam->value = dev_priv->chipset;
-               break;
-       case NOUVEAU_GETPARAM_PCI_VENDOR:
-               getparam->value = dev->pci_vendor;
-               break;
-       case NOUVEAU_GETPARAM_PCI_DEVICE:
-               getparam->value = dev->pci_device;
-               break;
-       case NOUVEAU_GETPARAM_BUS_TYPE:
-               if (drm_pci_device_is_agp(dev))
-                       getparam->value = NV_AGP;
-               else if (pci_is_pcie(dev->pdev))
-                       getparam->value = NV_PCIE;
-               else
-                       getparam->value = NV_PCI;
-               break;
-       case NOUVEAU_GETPARAM_FB_SIZE:
-               getparam->value = dev_priv->fb_available_size;
-               break;
-       case NOUVEAU_GETPARAM_AGP_SIZE:
-               getparam->value = dev_priv->gart_info.aper_size;
-               break;
-       case NOUVEAU_GETPARAM_VM_VRAM_BASE:
-               getparam->value = 0; /* deprecated */
-               break;
-       case NOUVEAU_GETPARAM_PTIMER_TIME:
-               getparam->value = dev_priv->engine.timer.read(dev);
-               break;
-       case NOUVEAU_GETPARAM_HAS_BO_USAGE:
-               getparam->value = 1;
-               break;
-       case NOUVEAU_GETPARAM_HAS_PAGEFLIP:
-               getparam->value = 1;
-               break;
-       case NOUVEAU_GETPARAM_GRAPH_UNITS:
-               /* NV40 and NV50 versions are quite different, but register
-                * address is the same. User is supposed to know the card
-                * family anyway... */
-               if (dev_priv->chipset >= 0x40) {
-                       getparam->value = nv_rd32(dev, NV40_PMC_GRAPH_UNITS);
-                       break;
-               }
-               /* FALLTHRU */
-       default:
-               NV_DEBUG(dev, "unknown parameter %lld\n", getparam->param);
-               return -EINVAL;
-       }
-
-       return 0;
-}
-
-int
-nouveau_ioctl_setparam(struct drm_device *dev, void *data,
-                      struct drm_file *file_priv)
-{
-       struct drm_nouveau_setparam *setparam = data;
-
-       switch (setparam->param) {
-       default:
-               NV_DEBUG(dev, "unknown parameter %lld\n", setparam->param);
-               return -EINVAL;
-       }
-
-       return 0;
-}
-
 /* Wait until (value(reg) & mask) == val, up until timeout has hit */
 bool
 nouveau_wait_eq(struct drm_device *dev, uint64_t timeout,
index 5edd3a76fffa9e1d59aa394beede3360c64c7581..2a5769fdf8ba9f65fbf3a358bba1ffab62660b34 100644 (file)
 #ifndef __NOUVEAU_DRM_H__
 #define __NOUVEAU_DRM_H__
 
-#define NOUVEAU_DRM_HEADER_PATCHLEVEL 16
-
-struct drm_nouveau_channel_alloc {
-       uint32_t     fb_ctxdma_handle;
-       uint32_t     tt_ctxdma_handle;
-
-       int          channel;
-       uint32_t     pushbuf_domains;
-
-       /* Notifier memory */
-       uint32_t     notifier_handle;
-
-       /* DRM-enforced subchannel assignments */
-       struct {
-               uint32_t handle;
-               uint32_t grclass;
-       } subchan[8];
-       uint32_t nr_subchan;
-};
-
-struct drm_nouveau_channel_free {
-       int channel;
-};
-
-struct drm_nouveau_grobj_alloc {
-       int      channel;
-       uint32_t handle;
-       int      class;
-};
-
-struct drm_nouveau_notifierobj_alloc {
-       uint32_t channel;
-       uint32_t handle;
-       uint32_t size;
-       uint32_t offset;
-};
-
-struct drm_nouveau_gpuobj_free {
-       int      channel;
-       uint32_t handle;
-};
-
-/* FIXME : maybe unify {GET,SET}PARAMs */
-#define NOUVEAU_GETPARAM_PCI_VENDOR      3
-#define NOUVEAU_GETPARAM_PCI_DEVICE      4
-#define NOUVEAU_GETPARAM_BUS_TYPE        5
-#define NOUVEAU_GETPARAM_FB_SIZE         8
-#define NOUVEAU_GETPARAM_AGP_SIZE        9
-#define NOUVEAU_GETPARAM_CHIPSET_ID      11
-#define NOUVEAU_GETPARAM_VM_VRAM_BASE    12
-#define NOUVEAU_GETPARAM_GRAPH_UNITS     13
-#define NOUVEAU_GETPARAM_PTIMER_TIME     14
-#define NOUVEAU_GETPARAM_HAS_BO_USAGE    15
-#define NOUVEAU_GETPARAM_HAS_PAGEFLIP    16
-struct drm_nouveau_getparam {
-       uint64_t param;
-       uint64_t value;
-};
-
-struct drm_nouveau_setparam {
-       uint64_t param;
-       uint64_t value;
-};
-
 #define NOUVEAU_GEM_DOMAIN_CPU       (1 << 0)
 #define NOUVEAU_GEM_DOMAIN_VRAM      (1 << 1)
 #define NOUVEAU_GEM_DOMAIN_GART      (1 << 2)
@@ -180,35 +116,19 @@ struct drm_nouveau_gem_cpu_fini {
        uint32_t handle;
 };
 
-enum nouveau_bus_type {
-       NV_AGP     = 0,
-       NV_PCI     = 1,
-       NV_PCIE    = 2,
-};
-
-struct drm_nouveau_sarea {
-};
-
-#define DRM_NOUVEAU_GETPARAM           0x00
-#define DRM_NOUVEAU_SETPARAM           0x01
-#define DRM_NOUVEAU_CHANNEL_ALLOC      0x02
-#define DRM_NOUVEAU_CHANNEL_FREE       0x03
-#define DRM_NOUVEAU_GROBJ_ALLOC        0x04
-#define DRM_NOUVEAU_NOTIFIEROBJ_ALLOC  0x05
-#define DRM_NOUVEAU_GPUOBJ_FREE        0x06
+#define DRM_NOUVEAU_GETPARAM           0x00 /* deprecated */
+#define DRM_NOUVEAU_SETPARAM           0x01 /* deprecated */
+#define DRM_NOUVEAU_CHANNEL_ALLOC      0x02 /* deprecated */
+#define DRM_NOUVEAU_CHANNEL_FREE       0x03 /* deprecated */
+#define DRM_NOUVEAU_GROBJ_ALLOC        0x04 /* deprecated */
+#define DRM_NOUVEAU_NOTIFIEROBJ_ALLOC  0x05 /* deprecated */
+#define DRM_NOUVEAU_GPUOBJ_FREE        0x06 /* deprecated */
 #define DRM_NOUVEAU_GEM_NEW            0x40
 #define DRM_NOUVEAU_GEM_PUSHBUF        0x41
 #define DRM_NOUVEAU_GEM_CPU_PREP       0x42
 #define DRM_NOUVEAU_GEM_CPU_FINI       0x43
 #define DRM_NOUVEAU_GEM_INFO           0x44
 
-#define DRM_IOCTL_NOUVEAU_GETPARAM           DRM_IOWR(DRM_COMMAND_BASE + DRM_NOUVEAU_GETPARAM, struct drm_nouveau_getparam)
-#define DRM_IOCTL_NOUVEAU_SETPARAM           DRM_IOWR(DRM_COMMAND_BASE + DRM_NOUVEAU_SETPARAM, struct drm_nouveau_setparam)
-#define DRM_IOCTL_NOUVEAU_CHANNEL_ALLOC      DRM_IOWR(DRM_COMMAND_BASE + DRM_NOUVEAU_CHANNEL_ALLOC, struct drm_nouveau_channel_alloc)
-#define DRM_IOCTL_NOUVEAU_CHANNEL_FREE       DRM_IOW (DRM_COMMAND_BASE + DRM_NOUVEAU_CHANNEL_FREE, struct drm_nouveau_channel_free)
-#define DRM_IOCTL_NOUVEAU_GROBJ_ALLOC        DRM_IOW (DRM_COMMAND_BASE + DRM_NOUVEAU_GROBJ_ALLOC, struct drm_nouveau_grobj_alloc)
-#define DRM_IOCTL_NOUVEAU_NOTIFIEROBJ_ALLOC  DRM_IOWR(DRM_COMMAND_BASE + DRM_NOUVEAU_NOTIFIEROBJ_ALLOC, struct drm_nouveau_notifierobj_alloc)
-#define DRM_IOCTL_NOUVEAU_GPUOBJ_FREE        DRM_IOW (DRM_COMMAND_BASE + DRM_NOUVEAU_GPUOBJ_FREE, struct drm_nouveau_gpuobj_free)
 #define DRM_IOCTL_NOUVEAU_GEM_NEW            DRM_IOWR(DRM_COMMAND_BASE + DRM_NOUVEAU_GEM_NEW, struct drm_nouveau_gem_new)
 #define DRM_IOCTL_NOUVEAU_GEM_PUSHBUF        DRM_IOWR(DRM_COMMAND_BASE + DRM_NOUVEAU_GEM_PUSHBUF, struct drm_nouveau_gem_pushbuf)
 #define DRM_IOCTL_NOUVEAU_GEM_CPU_PREP       DRM_IOW (DRM_COMMAND_BASE + DRM_NOUVEAU_GEM_CPU_PREP, struct drm_nouveau_gem_cpu_prep)